1,我做的FPGA项目要用到256块ram其中128块深度只有20另外128块深度60

xilinx开发板的带的ram大小是固定的,这个你可以看芯片的datasheet,里面有详细的资源描述。ram在使用的时候不只考虑深度,还要考虑宽度,一个ram的最大位宽和最大深度是有限定的,任何一个超了,都会额外使用另外的ram资源。像你要写的这段程序,你可以考虑使用一个或几个少量的ram,然后地址分段,比如0-19addr表示第一个ram,20-79表示第二个ram。当然如果几个ram同时读写的话就要另外想了。

我做的FPGA项目要用到256块ram其中128块深度只有20另外128块深度60

2,xilinx FPGA 烧写完程序怎么知道在配置芯片内占了多大

呵呵,不需要这么麻烦,烧结前就已经知道大小了。在你生成bit或bin文件时,有一个压缩选项,如果不压缩,那么生成的bit文件就是一个固定值,也就是在配置芯片中的需要的最大容量。而选择压缩,就是实际生成的容量。其实,这个值(最大)一般在datasheet下就可以看到,只要保证配置芯片大于该容量就OK了。 另外,MCS文件是可以看,但没必要去查,除非你需要查看里面的编译信息,而且00去数下。。。哈哈。。。你试试,估计会疯的。

xilinx FPGA 烧写完程序怎么知道在配置芯片内占了多大

3,xilinx系列fpga RAM配置的问题 求大神

XILINX的Block RAM每块是16K bit,可以配置成16K X1,8K X2,4KX4,。。。一直到512X36。你要实现的是124000X5 bit,当然不管内置的还是外置的RAM,都没有5 bit的宽度,一般还是要到8位的。但用BLOCKRAM有一个好处,你可以用5个124000X1的RAM来实现,其中一个124000X1需要由大概8块BLOCK RAM来实现,那么124000X5就需要8 * 5=40个BLOCK RAM来实现。4VSX25一共有128个BLOCK RAM,理论上资源是够的。BLOCK RAM当然是可以调用IP核的,XILINX提供一个LogiCore的工具,可以自由搭建你需要的宽度和深度的RAM。

xilinx系列fpga RAM配置的问题 求大神


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